我們看到很多芯片防控，都有一個(gè)JTAG口，這是干什么用的呢?

JTAG(JointTestActionGroup)聯(lián)合測(cè)試工作組適應性。是一種標(biāo)準(zhǔn)測(cè)試協(xié)議堅實基礎，主要用于芯片內(nèi)部的測(cè)試兼容IEEE1149.1協(xié)議，很多的高級(jí)芯片均具有這個(gè)協(xié)議重要作用，如FPGA等地、DSP等。

JTAG口一開始只是用來(lái)對(duì)芯片內(nèi)部進(jìn)行測(cè)試的尤為突出，他的原理就是在器件內(nèi)部定義一個(gè)名為TAP(TestAccessPort)測(cè)試訪問(wèn)口,然后通過(guò)專用的工具對(duì)內(nèi)部進(jìn)行測(cè)試∫幎?，F(xiàn)在環境，通過(guò)JTAG可對(duì)芯片內(nèi)部的所有部件進(jìn)行編程控制。

下面我們來(lái)介紹一下JTAG口的接口定義!JTAG口有很多的封裝供給，比如10腳、14腳和20腳經驗分享，盡管引腳的數(shù)目和排序不同深入各系統，但都是大同小異!

IEEE1149.1標(biāo)準(zhǔn)里是強(qiáng)制要求的如下：

1、TCK(TestClockInput)--JTAG口時(shí)鐘腳

測(cè)試時(shí)鐘輸入腳為TAP的操作提供了一個(gè)獨(dú)立的系列、基本的時(shí)鐘信號(hào)作用，TAP的所有操作都是通過(guò)這個(gè)時(shí)鐘信號(hào)來(lái)驅(qū)動(dòng)的。

2慢體驗、TMS(TestModeSelectionInput)-----測(cè)試模式選擇輸入腳

TMS信號(hào)可以控制TAP在不同的狀態(tài)之間進(jìn)行相互轉(zhuǎn)換著力增加，此信號(hào)在TCK的上升沿有效。

3科技實力、TDI(TestDataInput)-----測(cè)試數(shù)據(jù)輸入腳

TDI是所有要輸入到特定寄存器的數(shù)據(jù)串行輸入的接口處理。

4、TDO(TestDataOutput)-----測(cè)試數(shù)據(jù)輸出腳

TDO是所有要從特定的寄存器中輸出的數(shù)據(jù)串行輸出的接口在此基礎上。

5助力各行、(VTREF)-----接口信號(hào)電平

接口信號(hào)電平可以用來(lái)確定ARM的JTAG接口使用的邏輯電平。

IEEE1149.1標(biāo)準(zhǔn)里是可選項(xiàng)的要求如下：

1自主研發、TRST(TestResetInput)----測(cè)試復(fù)位輸入腳

TRST信號(hào)可以執(zhí)行與TMS一樣的功能確定性，即用來(lái)對(duì)TAPController進(jìn)行復(fù)位(初始化)。

2損耗、RTCK(ReturnTestClock)----反饋測(cè)試時(shí)鐘

此腳是用來(lái)同步TCK信號(hào)的講故事，由目標(biāo)端反饋給仿真器的時(shí)鐘信號(hào)，在不使用時(shí)直接接地性能穩定。

3全面革新、nSRST(SystemReset)----時(shí)鐘復(fù)位信號(hào)反饋腳

此腳可以檢測(cè)目標(biāo)系統(tǒng)的復(fù)位情況同時(shí)也可與目標(biāo)板上的系統(tǒng)復(fù)位信號(hào)相連,直接對(duì)目標(biāo)系統(tǒng)復(fù)位。建議為了防止誤觸發(fā)應(yīng)在目標(biāo)端加上適當(dāng)?shù)纳侠娮琛?

4情況正常、USERIN--用戶自定義輸入

此腳可以接到目標(biāo)機(jī)的一個(gè)IO上線上線下，用來(lái)接受上位機(jī)的控制。

5醒悟、USEROUT--用戶自定義輸出

此腳可以接到目標(biāo)機(jī)的一個(gè)IO上數據顯示，用來(lái)向上位機(jī)的反饋一個(gè)狀態(tài)。

實(shí)際上也逐步提升，這些可以選擇的腳記得牢，一般都是不使用的，在實(shí)際應(yīng)用中出現(xiàn)的20線等口重要的作用，主要是為了增加地線更多可能性，減小JTAG的干擾而出現(xiàn)的去創新。

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